fpga是什么 在DSPbuilder设计中怎么使用外部的VHDL/VerilogHDL代码？

在DSPbuilder设计中怎么使用外部的VHDL/VerilogHDL代码？

DSP Builder可以将Simulink中的模块转换为VHDL。Altera与MATLAB有接口。安装DSP Builder后，Simulink库中会出现相应的工具箱。只有工具箱中的模块才能转换为VHDL。您可以在Simulink中构建整个信号处理系统。仿真成功后，除输入输出信号外，系统的各个部分都可以转换成VHDL语言。之后，可以下载到quartus或模拟

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