用74ls161设计八进制计数器总结 74ls161为什么有两个使能端？
74ls161为什么有两个使能端？
74ls161是一个4位二进制同步计数器。为了实现同步功能，控制部分比较复杂，一个芯片只有4位。两个使能端易于多级级联，形成多位同步计数器。74ls138解码器有三个片选端子，也很好用。
同步计数器级联使用时，要求输出数据同时翻转，161的进位信号控制下一个芯片的使能端(片选)。允许下一个芯片计数时，第九个时钟前沿已经过去，计数器还没有计数，只是在第十个时钟到来时计数，各级计数器同步输出。同步计数器的时钟同时加到每个触发器上，这就是同步计数；异步计数器的时钟只加在第一个触发器上，进位信号作为下一级的时钟输入，是一种结构简单、异步输出的串行计数器。
这类问题应该贴在 "工程技术科学与工程。
时序逻辑电路的设计方法是什么？
时序逻辑电路定义
在数字电路中
理论上，时序逻辑电路
意味着电路在任意时刻的稳态输出不仅取决于当前输入，还取决于前一时刻输入形成的状态。这类似于组合逻辑电路
相反，组合逻辑的输出将只与当前输入有函数关系。换句话说，时序逻辑有存储元件来存储信息，而组合逻辑没有。
从时序逻辑电路中，可以构建两种形式的有限状态机:
摩尔有限状态机
输出只与内部状态有关。(因为内部状态只会在时钟触发边沿时改变，所以输出值只会在时钟边沿时改变)
米莉有限状态机
输出不仅与当前内部状态有关，还与当前输入有关。
因此，时序逻辑被用于构建某种形式的计算机存储器、延迟和存储单元以及有限状态自动机。大多数真实的计算机电路是组合逻辑和时序逻辑的混合。
时序逻辑电路的特性
功能特点
电路在一定采样周期内的稳态输出Y(n)不仅取决于采样周期内的瞬时输入X(n)，还取决于电路的初始状态Q(n)。(Q(n)通常记录以前周期的输入。)
结构特点
除了组合电路之外，时序电路必须包含用于存储信息的存储电路:触发器、寄存器和计数器。
等等。
时序电路分类
根据 "功能、用途及分为:
注册
；
计数器(分频器)
；
顺序脉冲发生器
；
顺序脉冲检测器
；
块转换器
；…
根据 "动作特征与技巧对于每个触发器，它分为:
同步时序电路:电路中所有触发器的状态变化是同步的。它的时钟方程式:cp1cp2...cpkcp ↓(或者CP↑)。也就是说，所有CP端子连接在一起，并由CP信号的同一有效边沿触发。
异步时序电路:
电路中根本没有CP同步信号。
对于相同的CP脉冲，每个触发是不相同的由有效边沿触发。
摩尔型和米莱型。
摩尔型:电路的输出Yn只取决于每个触发器的输出Q n，而与外部输入x n无关，即:yn f (q n)。
Milli型:电路的输出Yn不仅取决于每个触发器的输出Q n，还取决于外部输入x n .即:yn f (q n，X n)。
"完全描述 "和 "不完全描述 "具有k个状态变量的时序电路(k个触发器)最多可以描述k个不同的状态。
如果电路功能必须用几种状态来描述，则称之为 "完全描述 "(二进制)；
如果只描述了一个状态的一部分，则称之为 "不完全描述 "(非二进制)。
以上是数字逻辑电路的基础知识，什么是时序逻辑电路？
特定设备:
触发器:rs触发器，D触发器，T触发器，JK触发器等。
计数器:74LS161，74LS163，74LS290等。
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