vhdl语言入门 &在VHDL语言中是什么意思，具体怎么用呢？谢谢？

&在VHDL语言中是什么意思，具体怎么用呢？谢谢？

有多种含义，一种是文本连接器，连接前后的字符串，另一种是类型声明符。声明变量类型时，变量被声明为长整数，可以在&；中使用，例如Dimi&；第三个用于不同的十进制值，例如以八进制开头的&；以十六进制开头的&；中

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