vivado状态机设置安全模式 vivado仿真时输入为什么显示高阻态？

vivado仿真时输入为什么显示高阻态？

1. 看看是否有一个错误的名称和模块无法识别。

2. 查看是否将仿真激励文件设置为仿真模块的顶层文件。在这种情况下，设计的顶层文件将被视为vivado仿真的顶层文件，并且在仿真过程中输入将被识别为高电阻。在源代码的SIM中，右键单击模拟文件上的setastop，然后重新模拟它。

3. 在国外的论坛上也可以看到一种方法。据说是重建一个项目，复制出原始项目的源文件，将这些文件导入新项目，然后重新模拟

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